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SoC Design Engineer
하드웨어·임베디드
AI 요약
제품 요구사항에 맞춘 SoC 사양·아키텍처 수립 및 핵심 IP 설계·구성, SoC 서브시스템 및 탑 컨트롤 로직의 RTL 설계(Verilog) 및 검증, Peripheral/IP 통합·검증, ASIC 전체 설계 플로우에 따른 합성 및 정적 분석을 주도하는 SoC/ASIC 설계직 모집 공고입니다.
주요 업무
제품 요구사항에 최적화된 SoC 사양 및 아키텍처 수립; RTL(Verilog) 기반 디지털 회로 설계 및 시뮬레이션 검증; Peripheral IP 및 Subsystem 통합·검증; SOC TOP/Subsystem integration/verification 주도; 회로 합성(Synthesis) 및 ASIC Flow(Static Analysis - Lint, CDC, RDC, STA) 수행 및 관련 부서와 협업.
자격 요건
[필수] RTL 설계/검증 관심 또는 경험, 전자공학·컴퓨터공학 또는 관련 분야 학사 이상. [우대] AMBA 인터페이스(APB/AHB/AXI/CHI) 경험, ARM 아키텍처 이해, 고속 직렬 인터페이스(PCIe/USB/MIPI) IP 통합·검증 경험, DRAM controller/PHY 통합·검증 경험, D2D/C2C IP(UCIe/CCIX/BoW/CXL) 통합·검증 경험, GPU/Video Codec/Display/Camera IP 통합·검증 경험, SoC Top 또는 Subsystem 통합 경험, ASIC design flow 인터페이스 경험, SoC 프로젝트 리딩 경험.
기술 스택
VerilogRTLSimulationSynthesisASIC Design FlowLintCDCRDCSTAAMBA(APB/AHB/AXI/CHI)ARM ArchitecturePCIeUSBMIPIDRAM controller/PHYUCIeCCIXBoWCXLGPU IPVideo Codec IPDisplay IPCamera IP
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