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CPU Core Senior Physical Design Engineer

정규직(풀타임)대면혼합근무백엔드

AI 요약

커스텀 CPU의 RTL부터 GDS까지 물리 설계 구현을 담당하는 포지션으로, 합성, 배치·배선, 클럭 트리 합성, 플로어플랜, 정적 타이밍 분석, 전력/클럭 분배, 신뢰성 및 전력·노이즈 분석 등 CPU 물리 설계 전반과 검증·사인오프 업무를 수행합니다. 아키텍처·회로·논리·EDA 벤더와 협업하여 고속·저전력 CPU 설계를 최적화하고 물리 설계 방법론과 자동화 흐름을 개선합니다. (회사: Intel, 위치: 미국 캘리포니아 폴솜, 근무형태: 하이브리드, 연봉 범위 제공)

주요 업무

RTL부터 GDS까지 커스텀 CPU 물리 설계 구현(합성, 배치·배선, 클럭 트리 합성, 플로어플랜), 정적 타이밍 분석 및 타이밍 클로저, 전력·클럭 분배 및 전력 분석, 신뢰성 및 전력/노이즈 분석, 검증 및 사인오프(형식 동등성 검증, 레이아웃 검증, 전기 규칙 검사 등), 결과 분석 및 마이크로아키텍처 개선 권고, 논리·회로·아키텍처·EDA 팀 및 벤더와 협업, 제품 파라미터(전력/주파수/면적) 최적화, 물리 설계 방법론 및 플로우 자동화 개발 참여

자격 요건

최소 자격: 컴퓨터공학, 컴퓨터과학 또는 전기/전자공학 및 기타 STEM 관련 학사 학위와 6년 이상 경력 또는 석사 학위와 4년 이상 경력. 필수 경험/기술: VLSI 회로 설계 및 합성, 정적 타이밍 분석(Static Timing Analysis), 저전력 설계. 선호사항: x86 CPU 아키텍처 관련 2년 이상 경험, Tcl/Perl/Python 프로그래밍 경험 2년 이상. 추가 역량: 물리 클럭 설계, 타이밍 클로저, 멀티 파워 도메인 분석, 구조적 배치·배선, DFT, 레이아웃/전력/신뢰성 검증 등 CPU 특화 물리 설계 경험.

기술 스택

RTLGDSVLSI합성(synthesis)배치·배선(place and route)클럭 트리 합성(CTS)플로어플랜(floorplanning)정적 타이밍 분석(STA)전력/클럭 분배전력/노이즈 분석신뢰성 검증형식 동등성 검증(FEV)레이아웃 검증(LVS/DRC)전기 규칙 검사/ERC구조적 설계 검사DFTx86 CPU 아키텍처TclPerlPythonEDA 툴
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