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Design Engineer
정규직(풀타임)대면혼합근무하드웨어·임베디드
AI 요약
Intel Data Center Group의 SoC/칩용 소프트 IP 코어 마이크로아키텍처 및 RTL 설계 담당자 채용공고입니다. ASIC/SoC 전면(Front-end) 설계 및 검증(RTL 개발, 기능·성능 검증) 경험을 요구하며 Verilog/SystemVerilog, linting, 합성/타이밍 클로저, CDC, LEC 등의 툴 사용 능력과 PCIe 및 AMBA(AXI, AHB) 등 인터페이스 지식이 필요합니다. GitHub Copilot 등 AI 코딩 보조 도구 사용 경험이 언급되어 있으며 근무지는 인도 벵갈루루(하이브리드 근무)입니다.
주요 업무
차세대 칩(SoC 포함)을 위한 소프트 IP 코어의 마이크로아키텍처 및 RTL 설계, IP 블록 설계·개발·통합 및 SoC 컴포넌트용 IP 빌딩 블록과 방법론 개발. 성능·전력·비용 요소를 고려한 설계 수행 및 설계 품질 검증.
자격 요건
석사(전기/전자공학) + 관련 경력 4년 이상 또는 학사 + 관련 경력 6년 이상. ASIC 설계/검증(프론트엔드) 경험, RTL 개발 및 기능·성능 검증 역량, Verilog/SystemVerilog 숙련, linting·synthesis·timing closure·CDC·LEC 등 설계 품질 체크 도구 경험. PCIe 및/또는 AMBA(AXI, AHB) 관련 경험 우대. SVA 지식 및 RAS 도메인 경험 우대. GitHub Copilot 등 AI 도구 사용 경험, 성능·전력·비용 최적화 고려 능력, 팀 협업 역량 필요.
기술 스택
VerilogSystemVerilogRTLSVALintingSynthesisTiming closureCDCLECPCIeAMBA (AXI, AHB)GitHub CopilotSoCASIC 설계성능/전력/비용 최적화RAS (선호)
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