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Senior Analog Design Engineer

정규직(풀타임)대면혼합근무하드웨어·임베디드

AI 요약

Intel Central Engineering Group에서 고속 SerDes 및 die-to-die용 아날로그/혼합신호 IP를 설계·검증할 시니어 아날로그 설계 엔지니어를 채용합니다. 회로 설계, 레이아웃 협업, 실리콘 검증, 글로벌 협업 및 기술 리딩이 핵심입니다.

주요 업무

아날로그 및 혼합신호 회로/블록 설계·시뮬레이션·최적화, 트랜지스터 레벨 회로 아키텍처 개발, 레이아웃 엔지니어와 협업한 레이아웃 최적화, 회로 분석·검증 자동화 및 AI 지원 솔루션 활용, 설계 리딩 및 주니어 멘토링, 실리콘 검증/특성평가/디버깅, 전력·성능·면적 최적화, 글로벌 크로스펑셔널 팀과 협업.

자격 요건

전기/전자공학 또는 관련 학사 이상, 아날로그/혼합신호 회로 설계 경력 6년 이상. PLL, CDR, CTLE, DFE, ADC, RX AFE, TX, Power Delivery, IP floor planning, signal integrity 분석 중 하나 이상 경험. 고속 IO 캘리브레이션/트레이닝 알고리즘, UCIE/PCIe(Gen5/6/7) 등 고속 통신 표준 이해, FinFET CMOS 공정 경험, Cadence Virtuoso/ADE·HSPICE 등 툴 사용, 포스트 실리콘 검증/디버깅 경험 필요.

기술 스택

Cadence VirtuosoCadence ADEHSPICESynopsysVerilog-AMATLABPythonTclFinFET CMOSPLLCDRCTLEDFEADCSignal Integrity
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