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Senior CPU RTL Design Engineer – Power Management
정규직(풀타임)대면혼합근무하드웨어·임베디드
AI 요약
Intel CPU Design Team에서 차세대 고성능·저전력 프로세서를 위한 Senior CPU RTL Design Engineer(전력관리) 채용. CPU 마이크로아키텍처/RTL 설계, DVFS·전력상태 관리, PPA 최적화, CDC 및 디버깅을 수행하는 경력직 포지션입니다.
주요 업무
CPU 마이크로아키텍처 기능 정의/설계/구현, CPU IP 블록용 RTL(SystemVerilog/Verilog) 개발, PPA 최적화 및 전력 인지 RTL 설계, 멀티클록 도메인·CDC 솔루션 설계/검증, DVFS·전력/열 관리·리셋 플로우·전력 상태 전환 기능 기여, 복잡한 RTL 디버깅 및 검증팀 협업, SoC 통합팀과 full-chip 전달, 설계 방법론 개선 및 확장성 향상.
자격 요건
전기/전자공학, 컴퓨터공학, 컴퓨터과학 또는 관련 전공 학사 9년 이상 또는 석사 7년 이상 경력. DVFS·전력상태·전력 예산 등 전력관리 개념 경험, 저전력/전력인지 CPU 또는 SoC RTL 설계 경험, Verilog/SystemVerilog 기반 RTL 개발 경험, 디버깅 및 시스템 레벨 설계 이해 필요. 우대: 멀티클록 도메인/CDC, Intel Architecture ISA 및 x86 어셈블리, 고속 회로 설계, 타이밍 수렴, STA/UPF/lint 경험.
기술 스택
SystemVerilogVerilogRTLDVFSCDCUPFSTAlintx86 어셈블리
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