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IP Design Verification Engineer
정규직(풀타임)대면근무하드웨어·임베디드품질·테스트
AI 요약
Intel의 Mixed Signal Design Verification Engineer로서 혼합신호 IP 검증 계획 수립, 테스트벤치/검증환경 구축, 아날로그·디지털 디버깅 및 커버리지 분석을 수행하는 경력직 채용입니다.
주요 업무
혼합신호 IP 검증 계획 수립 및 실행, UVM/OVM 기반 테스트벤치와 검증환경 개발, 아날로그 behavioral modeling 수행, 프리실리콘 버그 식별·재현·디버깅, 커버리지 메트릭 분석 및 개선, 협업을 통한 검증 전략 최적화, 테스트 계획/방법론/결과 문서화 및 기술 리뷰 주도, 기존 검증 인프라·방법론 유지 및 개선.
자격 요건
전기공학, 컴퓨터공학 또는 관련 학사 이상과 4년 이상 경력, 석사 3년 이상 또는 박사 무경력 가능. SystemVerilog/Verilog, UVM/OVM, Synopsys VCS·Cadence Xcelium/JasperGold·Mentor Questa 등 EDA 툴, 아날로그 behavioral modeling 또는 고속 IO IP 검증/저전력 검증 경험, 아날로그·디지털 디버깅 역량, PCIe 및/또는 UCIe 프로토콜, 테스트 계획·환경·컨텐츠 개발 경험 필요.
기술 스택
SystemVerilogVerilogUVMOVMSynopsys VCSCadence XceliumCadence JasperGoldMentor QuestaAnalog Behavioral ModelingPCIeUCIe
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