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SoC Physical Design Engineer

정규직(풀타임)대면혼합근무하드웨어·임베디드

AI 요약

Intel의 Devices Development Group에서 Client SoC의 물리 설계(Physical Design)를 담당할 엔지니어 채용. RTL에서 GDS까지의 구현, 물리 합성, 배치·배선·클록트리 합성, 전력 도메인 분석(UPF/CPF), 타이밍/레이아웃/신뢰성 검증 및 signoff, 설계 최적화와 자동화/방법론 개선을 수행하는 역할. Bangalore(인도) 근무, 하이브리드 근무 모델, 경력직 채용.

주요 업무

RTL에서 GDS까지 물리 설계 구현; 물리 합성, 플로어플래닝, 배치, 배선, 클록 트리 합성 수행; UPF/CPF 기반 다중 전력 도메인 분석; 동등성 검증, 정적 타이밍 분석(STA), 신뢰성 및 레이아웃 검증, 노이즈 분석, 구조적 설계 체크 등 signoff 프로세스 수행; 결과 분석 및 설계 최적화 권고; 공정팀과의 공동 최적화를 통한 성능 개선; 물리 설계 방법론 개발 및 설계 플로우 자동화; 설계 트레이드오프에 대한 기술 자문 및 교차 기능 팀과 협업; 팀 기술 리더십 제공.

자격 요건

학사(전자/컴퓨터공학 등) 기준 10년 이상 경력 또는 석사 기준 8년 이상 경력. 물리 설계 도구 및 방법론(클록트리 합성, 정적 타이밍 분석, 플로어플래닝, 전력·노이즈 분석, RTL→GDS 워크플로우) 숙련. Synopsys/Cadence 등 업계 표준 툴 사용 경험. UPF/CPF 등 표준 전력 포맷으로 다중 전력 도메인 분석 경험. 동등성 검증, STA, 레이아웃 검증 등 signoff 절차 경험. Python/Perl/Tcl 등 스크립팅을 통한 자동화·플로우 개선 능력. 우대: 문제해결 능력, 팀 협업 능력, 툴/플로우/방법론 개선 경험 및 디자인 자동화 팀·벤더 협업 경험.

기술 스택

SynopsysCadenceUPFCPFPythonPerlTclStatic Timing Analysis (STA)Clock Tree Synthesis (CTS)FloorplanningPlacementRoutingRTL-to-GDS flowFormal Equivalence VerificationLayout VerificationPower/Noise Analysis
AI 점수 20none
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